由于时钟频率越快，芯片中的逻辑单元在单位时间内能够完成的操作就越多，所以频率与芯片性能成正相关。而芯片设计需要在 PPA 之间 tradeoff，那么如何才能知道一枚芯片正常工作的频率极限到底是多少呢？这就引入了 STA 静态时序分析的概念。
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